From 60099d1d69cde44e0cd6ebe7627bba81af28ecd4 Mon Sep 17 00:00:00 2001
From: Nguyen Anh Quynh <aquynh@gmail.com>
Date: Mon, 24 Aug 2015 13:58:52 +0800
Subject: [PATCH] x86: add back 2 registers X86_REG_FCW & X86_REG_FPIP

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 bindings/python/unicorn/x86_const.py | 424 +++++++++++++--------------
 include/unicorn/x86.h                |   2 +-
 2 files changed, 212 insertions(+), 214 deletions(-)

diff --git a/bindings/python/unicorn/x86_const.py b/bindings/python/unicorn/x86_const.py
index 1b78b9d4..124da17b 100644
--- a/bindings/python/unicorn/x86_const.py
+++ b/bindings/python/unicorn/x86_const.py
@@ -34,219 +34,217 @@ UC_X86_REG_ES = 28
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+UC_X86_REG_R10W = 236
+UC_X86_REG_R11W = 237
+UC_X86_REG_R12W = 238
+UC_X86_REG_R13W = 239
+UC_X86_REG_R14W = 240
+UC_X86_REG_R15W = 241
+UC_X86_REG_ENDING = 242
 
 # X86 instructions
 
diff --git a/include/unicorn/x86.h b/include/unicorn/x86.h
index ba6456fb..4ee6945e 100644
--- a/include/unicorn/x86.h
+++ b/include/unicorn/x86.h
@@ -21,7 +21,7 @@ typedef enum uc_x86_reg {
 	UC_X86_REG_DL, UC_X86_REG_DS, UC_X86_REG_DX, UC_X86_REG_EAX, UC_X86_REG_EBP,
 	UC_X86_REG_EBX, UC_X86_REG_ECX, UC_X86_REG_EDI, UC_X86_REG_EDX, UC_X86_REG_EFLAGS,
 	UC_X86_REG_EIP, UC_X86_REG_EIZ, UC_X86_REG_ES, UC_X86_REG_ESI, UC_X86_REG_ESP,
-	UC_X86_REG_FPSW, UC_X86_REG_FPCW, UC_X86_REG_FPIP, UC_X86_REG_FS, UC_X86_REG_GS, UC_X86_REG_IP, UC_X86_REG_RAX,
+	UC_X86_REG_FPSW, UC_X86_REG_FS, UC_X86_REG_GS, UC_X86_REG_IP, UC_X86_REG_RAX,
 	UC_X86_REG_RBP, UC_X86_REG_RBX, UC_X86_REG_RCX, UC_X86_REG_RDI, UC_X86_REG_RDX,
 	UC_X86_REG_RIP, UC_X86_REG_RIZ, UC_X86_REG_RSI, UC_X86_REG_RSP, UC_X86_REG_SI,
 	UC_X86_REG_SIL, UC_X86_REG_SP, UC_X86_REG_SPL, UC_X86_REG_SS, UC_X86_REG_CR0,